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24AA515/24LC515/24FC515
FIGURE 8-2:
RANDOM READ
Bus Activity
Master
S
T
A
R
T
Control
Byte
Address
High Byte
Address
Low Byte
S
T
A
R
T
Control
Byte
Data
Byte
S
T
O
P
SDA Line
S 1 0 1 0 B A A 0
0 1 0
x
S 1 0 1 0 B A A 1
0 1 0
P
Bus Activity
A
C
K
A
C
K
A
C
K
A
C
K
N
O
A
X = “don’t care” bit
FIGURE 8-3:
SEQUENTIAL READ
C
K
Bus Activity
Master
Control
Byte
Data n
Data n + 1
Data n + 2
Data n + X
S
T
O
P
SDA Line
P
A
C
A
C
A
C
A
C
N
O
Bus Activity
K
K
K
K
A
C
K
DS21673G-page 12
? 2008 Microchip Technology Inc.
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